半導体集積回路装置

Semiconductor integrated circuit device

Abstract

(57)【要約】 【課題】 対象となる集積回路の駆動電圧を制御するこ とを可能にする。 【解決手段】 ソースに第1の電源電圧が印加されるP チャネルMOSトランジスタM1と、ドレインがPチャ ネルMOSトランジスタのドレインに接続され、ソース に第2の電源電圧が印加されるNチャネルMOSトラン ジスタM2とを有し、共通に接続されたドレイン端から 電圧を出力するバッファ回路12と、第1のクロック信 号に同期して0から2 n −1までの数を1づつカウント アップすることを繰返しカウント値を第1のnビット信 号として出力するカウンタ3と、第1のnビット信号と 外部から供給される第2のnビット信号とを比較し、第 1の制御信号をPチャネルMOSトランジスタのゲート に出力するとともに第2の制御信号をNチャネルMOS トランジスタのゲートに出力する比較回路4とを有する デューティ比制御回路2と、バッファ回路の出力電圧を 平滑化する平滑化回路14と、を有し、平滑化回路によ って平滑化された電圧を出力する電圧変換回路を備えて いることを特徴とする。
PROBLEM TO BE SOLVED: To control the driving voltage of an integrated circuit by providing a duty ratio control circuit which outputs a 1st and a 2nd control signal and has a comparator circuit, a filter circuit which filters the output voltage of a buffer circuit, and a voltage converter circuit which outputs the filtered voltage. SOLUTION: The duty ratio control circuit 2 has a counter 3 and the comparator circuit 4. The counter 3 counts up one by one in every cycle of a clock signal and outputs its count value in a 6-bit signal NA. The comparator circuit 4 outputs signals X1 and X2 of the level L when the signal NA is '0' a in 6-bit signal value and signals X1 and S2 of level H when the signal NA reaches a signal NB. As an output signal Y, a pulse voltage signal is obtained from the signals NA and NB, filtered by a filter circuit 14, and supplied to the integrated circuit. With the external signal NB, the duty ratio of the signal Y is controlled to control the driving voltage of the integrated circuit. COPYRIGHT: (C)1998,JPO

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